安路科技: FPGA中block ram的特殊用法列举

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用法四:构造高速复杂的状态机

一般状态机原理框图如下:

基于rom的状态机原理如下:

· 首先明确 状态划分,状态跳转条件,状态输出

· 将现态输出与输入给到rom_a的地址端,初始化值为输出值

· 将现态输出与跳转条件给到rom_b的地址端,初始化值为次态输出

· 若状态不多,可以将rom_a与rom_b合并成一个真双口的rom

关于更多细节请参考如下相关文档:

1. 《基于FPGA的数字信号处理》 高亚军 电子工业出版社

2. EF2_datahseet_V3.9

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